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        《電子技術應用》
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        FPGA教學——如何自動產生一個UVM環境

        2022-08-11
        來源:FPGA之家
        關鍵詞: UVM環境 FPGA

          之前有朋友問我怎么用腳本產生一個驗證環境,這個問題今天和大家介紹下兩種做法。

          第一種用VCS自帶的uvmgen工具

          當你在命令行時直接輸入uvmgen會輸出如下信息

        微信圖片_20220811150703.png

          選擇1

          然后按照提示步驟進行UVM環境的創建

          微信圖片_20220811150715.png

          創建完之后我們看看環境目錄

          微信圖片_20220811150735.png

          剛才我們創建的env,agent,scoreboar,coverage收集模塊等都已經完備,跑環境的Makefile也都自動生成好了。對于一些簡單的UVM環境,用uvmgen還是非常適用的。

          但是采用這種方式產生UVM環境的局限也比較明顯,比如agent不能添加多個等,對于一些復雜的驗證環境還得自己手動添加。有沒有一種腳本能夠將整體框架大家好,甚至將驗證管理中的checklist都準備妥當。下面介紹的這個uvmdvgen.py 腳本將實現這些強大的功能。

          介紹下這個腳本實現的功能

          可以快速生成 agent;

          能夠根據用戶需求產生UVM環境;

          自帶checklist;

          自帶testplan;

          這里產生的UVM環境可以支持多個不同的agent,并且UVM環境的編碼風格對復用性非常友好。讓我們看看這款UVM的腳本是怎么使用的。

          用-a 單獨生成一個agent,例如

          uvmdvgen.py i2c -a

          生成i2c 的agent

          微信圖片_20220811150750.png

          用-s 可以一個agent里面增添 host driver 和device driver

          uvmdvgen.py i2c -a -s

          微信圖片_20220811150804.png

          講完agent,開始講environment,用-e 產出UVMenvironment

          uvmdvgen.py i2c -e

          微信圖片_20220811150812.png

          Checklist,Testplan,UVMenvironment 一應俱全。

          用-ea添加agent,可以隨便添加多少個agent

          uvmdvgen.py chip -e-ea uart i2c jtag

          微信圖片_20220811150821.png

          如此在environment添加agent便完成了。

          該腳本還可以用-hi和-hr實現是否有interrupt,register model等功能。

          是不是功能超級強大,迫不及待想用這個腳本的小伙伴可以在下面鏈接獲取。

        https://github.com/lowRISC/opentitan/tree/master/util/uvmdvgen


          更多信息可以來這里獲取==>>電子技術應用-AET<<

        微信圖片_20210517164139.jpg

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